对fpga上每一个模块都进行全局的复位有时候会面临消耗资源的问题，比如对FPGA内置的RAM而言。这些资源往往内部会有同步复位的逻辑，而缺乏异步复位的逻辑。如果设计的时候强行加上异步复位的逻辑会增加资源的开销
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上图这段代码中给RAM加上了异步复位的逻辑，与同步复位的RAM进行对比，资源开销如下：
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以上的例子说明，不正确的抚慰一个RAM可能对面积有惊人的影响
有时候综合工具会使用触发器的复位引脚来实现逻辑。如下图
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2.11为设计的逻辑，2.12为综合工具生成的逻辑，相比于前者，后者减少了一个门的开销
当面积是考虑的关键时，尽可能的避免使用置位和复位
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本文标题：面积结构设计
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