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FPGA-AXI学习(1)

FPGA-AXI学习(1)

作者: 和光同尘SCW | 来源:发表于2018-04-23 23:03 被阅读0次

一、分类

AXI4:主要面向高性能地址映射通信的需求,有五个通道,支持突发传输
AXI4-Lite:是一个简单地吞吐量地址映射性通信总线,有五个通道,不支持突发传输
AXI4-Stream:面向高速流数据传输,只有数据通道

突发传输与非突发传输示意如下: 突发传输

二、地址分配

1、地址需要对齐

举例:同一主机的两个从机地址分配
(1)地址范围:4K
  地址:0x4000_0000——0x4000_0FFF
(2)地址范围:64K
  地址:0x4000_1000——0x4001_0FFF (错误)
  原因:地址未对齐
  可改为:0x4001_0000——0x4001_FFFF
注:多主机对应同一从机,从机地址分配应相同

2、定义外部接口地址

  外接DRAM或是DRAM_Control往往较大,所以地址范围也大,所以定义其地址范围时应从最大地址0xFFFF_FFFF往下递减。
  如地址1G:
  地址范围为:0x6000_0000——0xFFFF_FFFF
注:Vivado在调用IP core时可以选择自动分配地址,在自己修改地址时如果地址分配错误会自动提醒,无法通过保存

3、外部地址与从机地址

  从机地址还需与外部地址相调和,不能产生冲突。如果从机地址与外部地址相冲突,主机会优先选择访问从机而忽略外部模块。

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    1 2 3 1 2 3 1、2、链接 引用粗体斜体

  • 学习1

    周五的质量考试,今天安排在会议室学习,内容真多,但很重要,都是一些很有用的东西,这样很好。

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